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数字SoC IC设计与优化

   随着集成电路工艺的飞速发展,SoC设计者正面临更多新的挑战,例如,复杂的时钟网络分析与优化、超大规模电路的时序收敛使得流片时间变得不确定、先进工艺条件下特别是低电压设计的时序签核、海量版图的审阅与集成、工艺库的质量分析等。

   华大九天提供了一系列数字SoC设计优化工具,支持7+/7nm先进工艺,帮助用户保证设计质量,提高设计效率,免去项目延宕忧虑,保证既定的流片安排。目前,数字SoC设计与优化工具已被列入国内外多家世界级设计公司的标准设计流程,国内市场占有率85%以上。被华为海思、紫光展锐、兆芯、Marvell、TSMC、中芯国际、长江存储、NVIDIA、XILINX、SanDisk、三星等近百家客户采用。

 

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